Professional Documents
Culture Documents
A). INTRODUCTION :
1°) Définitions :
a) Logique Combinatoire :
Un circuit est dit combinatoire lorsque l'état des sorties ne dépend uniquement que de l'état des
entrées.
e1 S1
Circuit
e2
Combinatoire
e3 S2
b) Logique Séquentielle :
Alors que pour un circuit séquentiel, la sortie dépend des entrées, et d'une variable interne. Cette
variable interne étant souvent la sortie précédente.
e1 S1
e2 Circuit
e3 Combinatoire S2
x Sx
Circuit
Sequentiel
ma ar S
0 0 0
1 0 1
0 0 1
0 1 0
0 0 0
d) Problème :
• Pour ma=ar=0 on a 2 combinaisons différentes pour S=1 et S=0
St-1 / ma.ar 00 01 11 10
0 0 0 X 1
1 1 0 X 1
St
5°) Logigramme :
ma
2 1 3
2 & 3
S
1 2
ar
1
1
S S Q 3 Q
2 4
R R Q/ Q/
b) Table de vérité :
R S Qn
0 0 Qn-1 Etat mémoire
0 1 1 Mise à 1
1 0 0 Mise à 0
1 1 X Dépend du constructeur
Qn = R.(S + Qn-1)
c) Table des excitations :
Qn-1 Qn S R
0 0 0 X
0 1 1 0
1 0 0 1
1 1 X 0
d) Réalisations :
A l'aide de portes NON OU :
Q n = R.(S + Q n-1 )
Q n = R + (S + Q n-1 )
e) Logigramme :
1
S
2 1 3
Q'
R
2 1 3
Q
R S Qn+1 Q’n+1
0 0 Qn Q’n Etat mémoire
0 1 1 0 Mise à 1
1 0 0 1 Mise à 0
1 1 0 0 Dépend du constructeur
g) Remarque :
Q'=Qn si R et S <> 1
h) Chronogrammes :
Q n +1 = R.(S . Q n )
j) Table de vérité :
R S Qn+1 Q’n+1
0 0 Qn Q’n Etat mémoire
0 1 1 0 Mise à 1
1 0 0 1 Mise à 0
1 1 0 1 Dépend du constructeur
k) Remarque :
Q'=Qn si R et S <> 1
Ce qui permet de supprimer une porte logique.
l) Schéma en logique négative :
R S Qn+1
0 0 1 Dépend du constructeur
0 1 0 Mise à 0
1 0 1 Mise à 1
1 1 Qn Etat mémoire
n) Circuits intégrés :
SN74279 ; SN 74118
o) Chronogrammes :
a) Constitution :
Une bascule synchrone est en fait constituée de deux bascules : une maître et une esclave. La
bascule maître effectue l'enregistrement des entrées, la bascule esclave l'affichage sur les sorties.
Particularité : S = D et R = D , on ne peut donc pas avoir S=R=0, pour la mise en mémoire ; donc
on réalise l'état mémoire avec H an niveau inactif.
3°) Table de vérité :
D'une bascule à niveau haut :
H D Qn+1 Qn+1
0 X Qn Qn Etat mémoire
1 0 0 1 Mise à 0
1 1 1 0 Mise à 1
Q n +1 = D n
b) Table de vérité :
D'une bascule à niveau haut et entrées supplémentaires asynchrones:
S R H D Qn+1 Qn+1
0 0 0 X Qn Qn Etat mémoire
0 0 1 0 0 1 Mise à 0
0 0 1 1 1 0 Mise à 1
1 0 X X 1 0 Mise à 1 asynchrone
0 1 X X 0 1 Mise à 0 asynchrone
7°) Chronogrammes :
D t
Q t
D t
Q t
D t
Q t
D t
Q t
8°) Utilisation :
a) Télérupteur :
b) Diviseur de fréquence :
On désire réaliser un diviseur de fréquence par 8, comment réaliser ce diviseur à partir de bascules
D?
E). LA BASCULE JK :
1°) La bascule JK synchrone :
a) Principe :
Une autre méthode pour palier à l'inconvénient de l'indétermination de la bascule RS consiste à
mettre en entrée deux portes NAND que l'on bouclera sur les sorties complémentaires.
J
& & & Q
K
& & Q/
&
c) Symbolisation :
4 7
J 1J Q
5
H C1
1 6
K 1K Q/
d) Fonctionnement :
- Une entrée d'horloge qui valide les entrées J et K
- Une entrée J de mise à 1 (synchrone), prise en compte qu'au moment donné de l'horloge.
- Une entrée K de mise à 0 (synchrone), prise en compte qu'au moment donné de l'horloge.
- Deux sorties Q et Q inverses l'une de l'autre.
e) table de vérité :
Pour une bascule niveau haut
H J K Qn+1 Qn+1
0 X X Qn Qn Etat mémoire
1 0 0 Qn Qn Etat mémoire
1 0 1 0 1 Mise à 0
1 1 0 1 0 Mise à 1
1 1 1 Qn Qn Inversion (TOGGLE)
Equation :
Qn = J.Qn-1 + K .Qn-1
Qn-1 Qn J K
0 0 0 X
0 1 1 X
1 0 X 1
1 1 X 0
g) Entrées suppléméntaires :
On peut avoir aussi des entrées supplémentaires :
- Une entrée Pr (Preset) ou S (Set) de mise à 1 de Q (asynchrone) (indépendante de
l'horloge), active au niveau haut.
- Une entrée Cl (Clear) ou R (Reset) de mise à 0 de Q (asynchrone) active au niveau haut.
On a alors le symbole suivant :
2 7
Pr
4 S Q
J
5 1J
H
1 C1
K
3 1K 6
Cl R Q/
3°) Chronogrammes :
J t
K t
Q t
Maitre-
Esclave
Q t
Niveau
Haut
Q t
Niveau
Bas
Q t
Front
Montant
Q t
Front
Descendant
Q t
Auto -
Blocage
t
Pr t
Cl t
J t
K t
Q t
Q t
4°) Utilisation :
- Vérifier la table de vérité précédemment obtenue. - câbler la bascule JK en diviseur par 2.
- Réaliser un diviseur de fréquence par 8 avec des bascules JK.
Schéma :
Chronogrammes :
t
H2
t
Bascule Niveau Haut
H1
t
H2
t
Bascule Niveau Bas
H1
t
H2
t
Bascule Fronts Montants
H1
t
H2
t
Bascule Fronts Descendants
H1
t
H2
t
Bascule Auto Blocage
H1
t
H2
D t
Q t
D t
Q t
D t
Q t
Bascules D à Auto-Blocage
H
D t
Q t
J t
K t
Q t
Maitre-
Esclave
Q t
Niveau
Haut
Q t
Niveau
Bas
Q t
Front
Montant
Q t
Front
Descendant
Q t
Auto -
Blocage
t
Pr t
Cl t
J t
K t
Q t
Q t