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Estudio de Circuitos
en Rgimen Transitorio
Teora de Circuitos I
Considerando v( ) 0
t
i(t)
1
v (t ) i d
C
v(t)
i(t)
1 0
1
1
v (t ) i d i d v t0 i d
C
C t0
C t0
v(t)
1
i (t ) i t0 v d
L t0
Condiciones
iniciales
Memoria:
Las condiciones inciales son equivalentes, desde el punto de vista
externo, a los siguientes cicuitos:
i
+
i
+
C
v1
-
i1
L
i0
v0
is
(A)
10
0
is(t)
+
C=5F
vC(t)
(a)
(b)
1
t(s)
-10
vc(t) (V)
2
0
(c)
1
t(s)
Si la forma de onda de corriente ic(t) en un capacitor lineal ( tensin vL(t) en un inductor ) permanece acotada en un intervalo cerrado [ta, tb], entonces la tensin vc(t) en el capacitor ( corriente
iL(t) en un inductor ) es una funcin continua en el intervalo
abierto (ta, tb).
Continuidad:
Una forma de demostrar matemticamente esta propiedades a
partir de las relaciones VA de los respectivos elementos
CAPACITOR
d v (t )
iC (t ) C C
dt
INDUCTOR
vL (t ) L
d iL ( t )
dt
i(t)
vS t v R t v L t
vs (t)
+
EDO lineal de
primer orden
di t
vS t R i t L
dt
x t xh t x p t
Solucin
Solucin
Homognea Particular
Para
los circuitos
Solucin
demostrar
Homognea
que la ecuacin
Solucin
homognea
Particular
asoRespuesta
en se puede
=
+
ciada slo
puede tener raices
reales negativas
parte
o de Rgimen
Libre oo complejas
de Rgimencon
Forzado
Rgimen
Transitorio
real negativa y las soluciones sern del tipo:
ek t
k t
e
sen t
lim xh t 0
t
Solucin Homognea
o de Rgimen Libre
iL
vc
vL
Rth
iL
vth(t)
vc
iN(t)
GN
L
+
d vC (t )
vC (t ) vth (t )
dt
Rth C Rth C
vL
d iL (t )
iL (t ) i N ( t )
dt
GN L GN L
d x (t )
x ( t ) x ( t )
dt
conocida x (0)
x t xlibre t x forzada t
vc libre t k1 e t /
vc t k1 e t / v
vc forzada t V fuente v
vc (0) k1 v ( ) k1 vc (0) v ( )
Reemplazando
en vc (t )
x t x x 0 x e t /
El mtodo puede usarse para hallar la tensin entre cualquier par de
nudos j y k, o la corriente en cualquier rama j, en una red lineal de
primer orden alimentada por fuentes de continua.
Observacin:
Solo puede utilizarse en circuitos donde el equivalente de Thevenin o
Norton exista y posea Rth 0 o GN 0 respectivamente.
x t x x 0 x e t /
Diremos que es estable si la solucin homognea tiende asintticamente a cero cuando t tiende a infinito. Caso contrario, podr ser inestable o marginalmente estable.
1,1 v x t v x t vL t
-1,1 2i t
di t
2 i t 2
0
dt
i (0 ) 10 A
dvc1 t
1
dt
C2
i d
i(t)
C1
C2
dvc1 t
d 2vc1 t C11 dvc1 t
RC1
i t
2
dt
dt
C2 dt
vc1 (0 ) 12 V
vc 2 (0 ) 0 V
x ti x x t0 x e
x(t0+ )
x t2 x
t2 t1 ln
x t1 x
con t2 t1
E
E RL t
i t i 0 e
R
R
i t
vR t R i t E 1 e
di t
vL t L
Ee
dt
siendo L / R
iR
E t
ilibre t e
R
E
ilibre t e 0,37
R
vR
: constante de tiempo
vL
t
0
t
E
i t 1 e
R
d i t
dt
t 0
E
L
d i t E R t
e
dt
R L
Determinacin grfica de t
rf
R
+
S
L
ifinal = 0
E
i t
e
rf R
con L / R
3.vX(t)
i(t)
16 V
vX (t)
0,8
H
Pag 17 Ej 5) En el siguiente circuito, la llave se abre en t = 0, excitando la red con un escaln de corriente IDC. Obtener y graficar v0(t).
iR
+
v C0
-
iL
i L0
+
v
i L0
t=0
+
v
-
L
t=0
- Respuesta forzada:
+
v C0
d uc t
iC t C
dt
d iL t
uL t L
dt
iL t iC t iR t
vR
R
vL
vs
+
C
vC
uL t
uR t
uC t
vS t
d 2uc t
d uc t
LC
RC
uc t vS t
2
dt
dt
Como tenemos ahora una EDO de orden 2 necesitaremos 2 condiciones iniciales, que podrn ser independientes o depenmdientes
&
&
LC u&
c lib t RC uc lib t uc lib t 0
El polinomio asociado resulta:
LC 2 RC 1 0
1, 2
RC ( RC ) 2 4 LC
R
R 2 1
2 LC
2L
2 L LC
uc lib t K1 e1 t K 2 e 2 t
02
iC t
iR t
iC
C
iL t
iL
iR
+
v C0
-
i L0
+
v
-
t
d uc t 1
1
C
uC t uC d 0
dt
R
L0
d 2uC t
1 d uc t 1
C
uC t 0
2
dt
R dt
L
L
2
LC 1 0
R
1,2
L / R
L / R
2 LC
4 LC
1
1
1
RC
LC
RC
02
x t K1 e 1 t K 2 e 2 t
16
6
5
14
4
12
3
10
2
8
1
0
6
-1
4
-2
2
-3
0
-4
0
10
15
20
25
x t K1 K 2 t e t
5
4.5
4
3.5
3
2.5
2
1.5
1
0.5
0
0
10
12
14
16
18
20
x (t ) K e t cos d t
10
8
6
4
2
0
-2
-4
-6
-8
0
10
15
20
25
x t K cos 0t
3
-1
-2
-3
0
10
15
x t xh t x p t
Rgimen sobreamortiguado
> o > 0 ambas races son reales y distintas 1 2
a) Anlisis respuesta libre
i t K1 e 1 t K 2 e 2 t
i 0 K1 K 2 i L 0
0 vR 0 vC 0 vL 0 vL 0 RiL 0 vC 0
Rgimen sobreamortiguado
b) Anlisis respuesta forzada (c.i. nulas)
i t K1 e 1 t K 2 e 2 t
6
i 0 K1 K 2 0 K1 K 2
E
E vR 0 vC 0 vL 0 vL 0 E
vC(t) ?
vR(t)
-1
0
vL(t)
5
10
15
Pag 24 Ej 2) Luego de haber estado en la posicin 1 un tiempo suficientemente largo, la llave L conmuta en t=0 a la posicin 2.
Hallar y graficar la evolucin vC(t) para t 0.
Amortiguamiento crtico
= o ambas races reales e iguales 1= 2 =
a) Anlisis respuesta libre
i (t ) K1 K 2 t e t
35
R
1
30
2L
LCv (t)
25
R
40
20
15
b) Anlisis
respuesta forzada (c.i. nulas)
E
10
5
i (0) 0 K1 0
E v-10R 0 vC 0 vL 0 vL v0L(t)
E
-5
10
15
0,8H
+
6V
F vc
t=0
i t K1 e
1 t
K2 e
2 t
i (0) K1 K 2 K1 i (0) K 2 1
vL 0 R i 0 vC 0 K1 1 K 2 2 2
K1
1
R 2 iL 0 vC 0
2 1
K2
1
R 1 iL 0 vC 0
1 2
uc (0) K1 K 2 K1 uc (0) K 2 1
iC 0 C K1 1 K 2 2 i 0 2
iL 0
2 C 0 C
1
iL 0
K2
2 1 1 C 0 C
K1
1
1 2
Regimen subamortiguado
0 < < o races complejas conjugadas 12 = - j d
a) Anlisis respuesta libre
uc t K1 e 1 t K 2 e 2 t
Como ya sabiamos:
1
iL 0
K1
1 2 2 C 0 C
1
iL 0
K2
1 vC 0
2 1
C
K1 K 2*
A K1 K 2
B j K1 K 2
i t e t A cos d t Bsen d t
C = 0,1 F L = 0,1 H
E = 10 V
Como i 0 0 A 0
R = 0,1
8
R=1
i t 6 B e t sen d t
i(t)
R=2
4
R=5
Por LKT
en la malla : u R t u L t uC Rt =10E
2
10
d iL t
uL t L
dt
u L 0 L B d
-2
-4
2L
E t
i t
e sen d t
L d
-6
-8
-10
0
0.5
1.5
2.5
uL 0 E
u L 0
E
B
L d L d
1
0
LC
2
3.5d 4 02 4.5
2 5 con
0
5.5
t=0
S
10V
vR(t)
t=0
1
1H
20V