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Matheus Rufino
160925 UNICAMP (IFGW)
FONTE CHAVEADA
Introduo e resumo.
Com a inteno de modelar uma fonte de alimentao eletrnica incorporada de um regulador chaveado, doravante Fonte
Chaveada, monta-se um circuito composto de 5 sub-blocos, sendo cada bloco um circuito com uma funo especfica.
Neste relatrio, os cinco circuitos que compe a fonte e a fonte sero criteriosamente analisados em respeito principalmente a sua
caracterizao e uma anlise eletrnica sobre o funcionamento de cada componente e como o todo se apresenta.
Dessa forma, visamos observar o comportamento componente-a-componente de uma fonte que possui um circuito controlador
interno que chaveia (comuta) a corrente, ligando e desligando rapidamente, de forma a manter uma tenso de sada estabilizada. O relatrio
tem a proposta de apresentar e explicar o funcionamento desse circuito e tambm testar os modelos fsicos que circundam esse universo.
ndice
1. Anlise por bloco do circuito da fonte chaveada: Anlise e caracterizao de todos os circuitos
(blocos) que compe a fonte chaveada.
A frequncia desse oscilador uma funo da capacitncia, a resistncia em srie e o que aponta a tenso de referncia:
+1 -1
f = 2 RC ln (2)
1-
O decaimento do capacitor forma o oscilador que possui um ciclo que uma rotina, supondo Vout = Vs, da forma:
1. O capacitor carrega at que Vc (V+) = (1/2)Vs = VR, sendo Vs a tenso que polariza o OP1;
2. A partir deste ponto Vosc -Vs;
3. O capacitor vai descarregar e recarregar negativamente at que Vc (V+) = VR;
4. A partir deste ponto Vosc + Vs, recomeando o ciclo.
A tenso de sada, Vosc, que ser usada para alimentar o prximo bloco da fonte chaveada, pode ser caracterizada da forma:
R7 R7
I) Se Vosc = Vs V+ = R7+R6 Vs implicando que o comparador muda de sinal quando V+ Vc < 0 Vc = R7+R6
Vs.
R7 R7
II) Se Vosc = Vs V+ = R7+R6 Vs implicando que o comparador muda de sinal quando V+ Vc > 0 Vc = R7+R6 Vs.
Para v- tenso AC na entrada inversora e vo tenso AC na sada, pino 6. (Lei dos ns de Kirchoff ) .
Resolvendo a equao diferencial:
v- v- v0 v- t
+ = = v- = v0 - A -t/(R C) (7)
t RC RC (v0 - v- ) RC
t = 0 : v- = - L = L - A 0 A = L ( + 1) (8)
T T
t = : v- = L = L - L( + 1) - 2 R C (9)
2
Assim,
T ( - 1)
- 2 R C = (10)
( + 1)
( - 1)
T = 2 R C ln (11)
( + 1)
(12)
Para gerar as curvas tericas para VC , V+ e VOSC utilizaremos as seguintes funes como modelo:
Figura a.1: Experimental Tenso (V) nos pinos 2,3,6 vs Tempo (s)
10
5
Tenso (V)
0
-5
-10
Tempo (s)
Pino 2: VC carga/descarga Capacitor Pino 3: V+ tenso na entrada no inversora
Pino 6: Vosc tenso de sada do oscilador de relaxacao
Figura a.2 Tenso (V) vs Tempo (s): Modelo e Experimental para VOSC
10
5
Tenso (V)
-5
-10
Tempo (s)
Uma onda quadrada de amplitude (12 1) V e frequncia de 4.08 kHz como sada do nosso oscilador de relaxao experimental.
Figura 1.3 Tenso (V) vs Tempo (s): Modelo e Experimental para VOSC
2
Tenso (V)
Out[181]= 0
-2
-4
-6
Tempo (s)
Tenso (V) para V+ Experimental FIT V+ [t] := 6` SquareWave[0.00408` t]
Uma onda quadrada de amplitude (6 1) V e frequncia de 4.08 kHz como a tenso na entrada no-inversora V+ H amplificao
do sinal de sada! ||Vosc|| = 2 || V+ ||
5
Tenso (V)
0
0 20 40 60 80 100
Tempo (s)
4
Tenso (V)
0
105 110 115 120 125 130 135 140
Tempo (s)
Circuito 1. b. Integrador
1.b. Integrador
O circuito integrador de modo geral, designado pelo nome de Integrador de Miller, caracteriza-se pela funo
1 t
vout (t) = - vin (t ') t ' (16)
RC 0
Experimentalmente, para o projeto da fonte chaveada, utilizamos o circuito da figura 3 composto com uma resistncia R3 (100 1)
k afim de limitar o ganho em d.c.
j 1 -1 Vosc(t)
Vint (t) = - + (20)
2 f C2 R3 R4
Podemos observar que para baixas frequncias a resistncia R4 controlar para que a tenso nos terminais do capacitor no sejam grandes
demais, ou seja, a medida que o capacitor esteja carregado o suficiente a corrente no mais passar por ele e ser ento dissipada em R4
que funciona como um limitador de ganhos para baixas frequncias.
Portanto, estamos garantindo que para a frequncia desejada no projeto o circuito integrador possa operar da forma que o sinal de entrada
saa em Vint integrado (equao 20). Com a finalidade de observar o funcionamento deste bloco e como ele se relaciona com a fonte
chaveada, adquirimos os sinais de entrada e sada versus o tempo mostrados nas figuras abaixo:
Figura b.1 Tenso (V) vs Tempo (s): Entrada e Sada do Circuito Integrador
10
5
Tenso (V)
0
Out[183]=
-5
-10
-15
0 200 400 600 800 1000
Tempo (s)
Entrada VOSC (V) no circuito integrador
12.4 TriangleWave[0.136 + 0.003755 t]
Sinal de sada VINT (V) do circuito integrador
10
5
Tenso (V)
0
Out[185]=
-5
-10
-15
200 300 400 500 600
Tempo (s)
Sinal de sada VINT (V) do circuito integrador 12.4 TriangleWave[0.136 + 0.003755 t]
Dessa forma estaremos fornecendo uma onda triangular para a entrada no inversora do Op.Amp 3 que ser o gerador de pulsos da fonte
chaveada.
10
5
Tenso (V)
0
Out[187]=
-5
-10
-15
0 200 400 600 800 1000
Tempo (s)
Sinal de entrada VINT (V) no circuito gerador de pulso
Sinal de sada Vpulso (V) do gerador de pulso 14.255 SquareWave[0.174 + 0.00371 t]
Tenso VRef = (5.0 0.1)V
Conforme a tenso de referncia na entrada no inversora varie, a largura do pulso tambm ir variar. Este o aspecto primordial para o
funcionamento da fonte chaveada uma vez que parte do sistema de controle da tenso ser comandado por este comparador uma vez que a
tenso de referncia passa a ser dada pelo bloco de feedback.
IE = IC + IB (21)
Ic IE e IB << IC = IC / IB (22)
No caso do circuito montado com base comum, VE ~ VB - 0.7V para Vin > 0.7. Portanto, como no h resistncia no coletor temos que a
impedncia da entrada muito maior do que a de sada havendo assim ganho de corrente sem ganho de tenso.
Av = vout / vin = Vout / Vpulso 1. , enquanto Vin > 0.7 V. (24)
A figura d.1 apresenta uma curva caracterstica do transistor em que a tenso medida no eixo y pode ser interpretada como a corrente no
coletor. O ponto de operao desejado deste transistor o ponto de corte, onde ele ir funcionar como uma chave:
Figura d.1 Tenso (V) vs Tempo (s): VOUT
3.0
2.5
Tenso (V)
2.0
1.0
0.5
0.0
0 20 40 60 80 100 120
Tempo (s)
VOUT com (5.00.1) V para teste
Na figura d.2 temos caracterizadas a entrada e sada deste bloco do circuito, sendo a sada a prpria tenso de sada da fonte.
10
5
Tenso (V)
0
Out[356]=
-5
-10
-15
0 200 400 600 800 1000
Tempo (s)
Tenso VOUT (V)
Sinal de sada Vpulso (V) do gerador de pulso
Vsubtr = a V+ - b V- (28)
R12 R9
a= 1+ (29)
R11 R10 + R9
R12
b= , como R9,12 = 100 k a = b (30)
R11
Portanto, para esse caso experimental temos que Vsubtr = V+ - V- sendo V+ a tenso de referncia controlada por um potencimetro e V-
a tenso rejeitada na malha de Vout . O valor da sada Verro ou Vsubtr ser integrada pelo circuito integrador e esse valor ser armazenado
para ser usado na prxima iterao da fonte.
2) Gerador de Pulso, comparador e feedback: A onda triangular comparada com o sinal da integrao da diferena amplificada nos
Op.Amp 6 e 5 respectivamente. Enquanto o circuito integrador no saturar em seu limite fsico esse pulso ser da largura necessria para
que o prximo bloco rejeite ou no tenso com a atuao do transistor, dando um ganho de corrente se necessrio. Dessa forma estamos
garantindo que a tenso de sada da fonte ser constante e controlada por uma tenso de referncia definida.
3) Transistor como chave e filtro (capacitor): O terceiro e ltimo bloco um transistor polarizado com emissor comum numa tenso DC de
(15.00.1)V. A funo desse transistor manter um ganho de corrente Av 1 e funcionar como uma chave liga/desliga para a passagem
de corrente da base para o emissor. Esse sinal ser ento filtrado pela carga de um capacitor em paralelo e parte dele ir voltar ao bloco do
feedback e ento ser feita a diferena entre esse sinal e a referncia. Enquanto o integrador do bloco 2 for capaz de integrar esse sinal da
diferena, a fonte ir estabilizar a sada de tenso e estar funcionando normalmente.
2.b. Caracterizao
A caracterizao da fonte chaveada fica a critrio dos sinais de sada Vout, a sada do integrador feedback para o comparador, Verro e o
Vpulso.
Caracterizao do sinal de sada Vout em relao ao Verro
Figura 2.b.
Sinais VErro e VOut (V) em relao a VRef (V)
12
10
Tenso (V)
8
Variao de VErro
Out[386]=
6
Variao de VOut
4
0
0 2 4 6 8 10 12 14
Bibliografia:
Brophy, J. J. Basic electronics for scientists. McGraw-Hill, New York, 5th edition.