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Com isto a tela de apresentao do aplicativo Project Wizard ir se abrir. Esta janela mostrada na Figura 2.
Universidade Federal de Minas Gerais Escola de Engenharia Departamento de Engenharia Eletrnica Laboratrio de Sistemas Digitais Tutorial 1 Quartus II Desenvolvimento de Projetos via Esquemtico
Nesta tela pode-se escolher o diretrio do projeto, o nome do projeto e o nome da entidade principal do projeto. recomendvel que para cada projeto, uma pasta diferenciada seja criada, para que no haja conflito entre os diversos arquivos gerados para cada projeto.
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Uma vez preenchidos os campos corretamente, clique em Next. A tela da Figura 4 aparecer.
Nesta tela possvel incluir arquivos ao projeto. Atravs do boto ... ao lado do campo File Name possvel definir o diretrio do arquivo a ser includo. Uma vez selecionado o arquivo, clique em Add para adicion-lo ao projeto. Quando todos os projetos desejados forem includos, clique em Next. Com isso a tela da figura 5 aparecer. OBS: Caso esteja criando um projeto que no se utiliza de componentes previamente criados apenas clique em Next.
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Nesta tela deve-se escolher o componente a ser utilizado para implementar o projeto, ou seja, em qual dispositivo lgico programvel o sistema ser gravado. A famlia do dispositivo pode ser definida no campo Device Family. Na seo Show in Avaliable device list possvel realizar um filtro de componentes conforme algumas caractersticas como encapsulamento (package), quantidade de pinos (pin count) e faixa de velocidade (speed grade). Na lista Available devices so apresentados todos os componentes da famlia escolhida que atendam aos requisitos definidos pelo filtro de componentes. Selecione o dispositivo adequado e clique em Next para prosseguir para a prxima tela. OBS: Observe no kit de desenvolvimento qual o dispositivo utilizado.
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Nesta janela possvel utilizar outras ferramentas de desenvolvimento em conjunto com o Quartus II, para isto a ferramenta a ser utilizada deve estar instalada no computador, uma vez que estas ferramentas no acompanham o pacote de instalao do Quartus II. No curso de sistemas digitais no ser utilizada nenhuma ferramenta adicional. Assim sendo, clique em Next.
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Esta tela apresenta um resumo do projeto a ser criado. Verifique se todos os dados conferem com os desejados, caso haja algo incorreto retorne tela adequada, por meio do boto back e corrija o erro. Caso no haja erros, clique em Finish. Ao final do processo a janela de projeto (Project Navigator) conter o projeto criado, como mostrado na Figura 8.
3. Desenvolvendo um projeto usando diagrama esquemtico O uso de diagramas esquemticos uma das maneiras de se definir a lgica de um sistema digital dentro do ambiente de projeto do Quartus II. Neste modo de projeto os componentes bsicos de eletrnica digital (Portas lgicas, Flip-flops, Multiplexadores, etc) so representados por meio de blocos, os quais podem ser arranjados e associados de forma a se definir uma lgica de funcionamento. Para se iniciar o desenvolvimento de um projeto que utilize o modo de diagrama esquemtico, necessrio, primeiramente, adicionar ao projeto principal um arquivo que comporte este tipo de entrada. Assim sendo, para adicionar um arquivo de diagrama esquemtico ao projeto clique em File -> New..., como mostrado na Figura 9.
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Figura 10 - Tela de Abertura de um novo arquivo esquemtico dentro do projeto Menu FileNew...
Nesta janela possvel escolher o tipo de arquivo que se deseja criar (Diagrama esquemtico, VHDL, etc). Selecione a opo Block Diagram / Schematic File e clique em Ok. Um novo arquivo de diagrama esquemtico aparecer na janela principal do Quartus II.
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Para salvar este arquivo clique em File -> Save as... e d um nome ao arquivo, salvando-o preferencialmente na pasta do projeto principal. OBS: Para arquivos de descrio de hardware, deve-se sempre lembrar que o nome da entidade principal do arquivo deve ser igual ao nome do arquivo. A tela de edio de diagramas esquemticos mostrada na Figura 11, onde so destacadas as funes de alguns botes: Atracar/Desatracar Janela: Permite separar a janela de diagrama esquemtico da janela principal do Quartus II Ferramenta de Seleo: Permite selecionar elementos inseridos no arquivo. Ferramenta de texto: Permite inserir teto no arquivo, com fins explicativos ou de documentao. Ferramenta de smbolo: Permite inserir smbolos (componentes). Seu uso ser detalhado posteriormente. Ferramenta de conexo: Realiza a ligao entre terminais dos componentes. Ferramenta de barramento: Realiza a ligao de barramentos (conjunto de sinais associados).
Atravs da ferramenta de smbolos possvel inserir componentes no arquivo. Clique nela (ou d dois cliques na tela em branco) para inserir um componente. Feito isso a janela mostrada na Figura 12 aparecer.
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Nessa janela, no campo Libraries, possvel explorar as diversas colees de componentes do Quartus II. As mais relevantes so listadas abaixo: Megafunctions: Tratam-se de funes complexas j prontas, necessitando muitas vezes de configurao. Others: o Maxplus2: esta coleo possui modelos de componentes equivalentes aos da famlia de dispositivos 74xx. Dessa forma possvel realizar qualquer combinao lgica feita com componentes discretos dentro do CPLD. Primitives: componentes bsicos: o Buffers: diversos tipos de buffers, incluindo os de sada tri-state. o Logic: Elementos lgicos bsicos (AND, OR, NOR, XOR, etc...) com diversos nmeros de entradas. o Others: elementos diversos. o Pin: diversos tipos de pinos suportados pelo componente: entrada, sada ou bidirecional. o Storage: elementos de armazenamento de dados, ou seja, flip-flops de diversos tipos. Selecione o componente desejado e clique OK. Exemplo: Para exemplificar o modo de desenvolvimento via diagrama esquemtico, ser realizada a montagem de um circuito combinacional capaz de executar a operao:
S = ( A B) (C D)
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Primeiramente insira as portas lgicas necessrias e os pinos de entrada e sada, como mostrado na Figura 13. (Para renomear os pinos de entrada e sada d duplo clique sobre o pino a ser alterado)
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Compile o projeto. Para isso clique em Processing -> Start Compilation, ou clique
no item de compilao na janela principal, como mostrado na Figura 15. Esse processo bastante complexo e pode demorar vrios segundos para ser concludo. Na janela de status possvel acompanhar a evoluo de cada uma das etapas de compilao.
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Ao final do processo de compilao aparecer, abaixo da tela do diagrama esquemtico, uma janela de mensagens com o resultado da compilao. Caso algum erro, no processo de compilao, ocorra ele ser mostrado nesta janela, com indicaes do motivo da ocorrncia e, no caso de linguagens de descrio de hardware, da parte do cdigo onde se encontra o erro. Corrija sempre os ocasionais erros e repita o processo de compilao. 4. Simulao de projetos O Quartus II permite realizar simulaes do projeto desenvolvido. Essas simulaes podem ser de dois tipos: funcional e de tempo. A simulao funcional permite verificar se a funcionalidade do projeto desenvolvido est correta; em outras palavras, a simulao funcional verifica a lgica. Por sua vez, a simulao de tempo verifica as caractersticas de temporizao, que so inerentes construo interna do CPLD ou FPGA usado e da forma como o projeto construdo dentro do chip; ou seja, simulao temporal verifica o funcionamento real do projeto. O primeiro passo para simular criar um arquivo de entradas de simulao. Esse arquivo vai aplicar s entradas de sinais as condies possveis de funcionamento de forma que a sada possa ser ento avaliada. Para criar um arquivo de simulao, clique em File -> New..., escolha o tipo de arquivo Vector Waveform File. Assim a tela a seguir ser aberta.
Nessa tela possvel a incluir os sinais de entrada e literalmente desenhar as formas de ondas dos sinais aplicados. Para inserir sinais v a Edit -> Insert -> Insert Node or Bus... ou d um clique duplo na tela em branco logo abaixo da coluna Name. Fazendo isso a seguinte tela ir se abrir:
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No campo Filter possvel escolher a categoria de sinais com os quais se deseja trabalhar. O campo Look in informa qual projeto ou arquivo ser usado. Por fim clicando em List sero apresentados todos os sinais do projeto. Para incluir um sinal na simulao, selecione-o no campo Nodes Found e clique no boto > ; os sinais selecionados sero transferidos para o campo Selected Nodes. Devem ser selecionados os sinais de entrada, e os de sada, cujo resultado se deseja analisar. Uma vez que todos os sinais tenham sido escolhidos, clique em Ok, retornando assim tela da Figura 17. Clique novamente em Ok, para retornar tela do editor de formas de onda.
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Antes de se iniciar a edio dos sinais de entrada, necessrio definir o tempo total de simulao e o tamanho do grid. Para isso, inicialmente clique em Edit - > End Time..., a seguinte tela ir se abrir:
Nesta janela, no campo Time: pode-se definir o tempo total, no qual se deseja analisar o comportamento do sistema projetado. Uma vez definido o tempo total de simulao, clique em Edit -> Grid Size..., e defina o tamanho do grid, ou seja, o intervalo de tempo que ser demarcado na tela do editor de forma de onda. A utilizao do grid facilita o trabalho de desenhar as formas de onda desejadas. A tela do Grid Size mostrada na Figura 20.
OBS: Para facilitar a visualizao de eventos interessante que o tempo total de simulao e o tamanho do grid sejam da mesma ordem de grandeza. Uma vez definidos estes itens, pode-se iniciar o processo de desenhar as formas de onda. Para tal utiliza-se os os botes encontrados na parte esquerda da tela de edio de formas de onda, dos quais alguns so descrito na tabela a seguir.
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Uma vez configuradas as formas de onda dos sinais de entrada, slave o arquivo clicando em File -> Save as... O passo seguinte definir as configuraes da simulao. Para isso, clique em Assignments -> Settings... e escolha a categoria Simulator settings. A seguinte tela se abrir:
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Nesta tela, escolha Functional no campo Simulation mode. Em seguida selecione o arquivo de formas de onda no campo Simulation Input. Por fim, clique em Ok. Para dar incio agora a simulao clique em Processing -> Start simulation. Esse processo pode demorar algum tempo. Ao completar a simulao uma nova janela, semelhante a janela de edio de forma de onda, deve ser apresentada. Caso esta janela no aparea, clique em Processing -> Simulation Report. As Figuras 22 e 23 mostram as telas do editor de formas de onda e do Simulator report, respectivamente, aps a edio das formas de onda dos sinais de entrada e da simulao do projeto.
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Uma vez criado o circuito, deve-se definir a qual pino fsico do CPLD cada pino do esquemtico est ligado. Para isso clique em Assignments -> Pins. Abrir a janela a seguir, que permite definir a ligao entre os pinos fsicos e os pinos do diagrama.
Nessa tela apresentada uma figura da pinagem do CPLD. Na coluna Node Name esto listados os pinos presentes no projeto. Na coluna Direction est descrita a direo desse pino. Na coluna Location, pode-se definir a qual pino fsico estar ligado o pino lgico. Para isso, d um clique duplo em uma celula da coluna Location e escolha o pino desejado na lista que aparecer. Repita esse processo para todos os pinos. Para validar a atribuio de pinos repita a compilao e observe se no ocorrem erros. Feita a associao dos pinos do CPLD, pode-se ento gravar o projeto no dispositivo lgico programvel disponvel. Clique em Tools -> Programmer, chamando assim a seguinte tela:
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Na rea de configurao apresentada, preciso assegurar que as opes de hardware estejam corretas, atravs do atalho Hardware Setup.... Caso no haja nenhum hardware selecionado, em Add Hardware selecione manualmente ByteBlaster ou USBBlaster, conforme o gravador do kit utilizado. Ainda preciso marcar a opo Program/Configure. Outras opes como verificao da gravao so tambm disponibilizadas. Clique em Start para iniciar gravao. A janela de mensagens da tela principal do Quartus II ir informar se a gravao foi executada com sucesso. Caso isso ocorra, seu projeto j estar rodando no CPLD. Caso haja algum erro de gravao, verifique se: Os cabos esto corretamente ligados O kit est ligado O modelo de gravador est correto O modelo de CPLD est correto 6. Desenvolvendo um projeto usando VHDL O VHDL uma linguagem de descrio de hardware. Para se iniciar o desenvolvimento de um projeto que utilize o modo VHDL, necessrio, primeiramente, repetir os passos de criao de um projeto descrito no item 2 deste tutorial. Aps isto, adicionar ao projeto principal um arquivo que comporte este tipo de entrada (VHDL). Assim sendo clique em File -> New..., como mostrado na Figura 9. Uma vez feito isso, a janela mostrada na Figura 10 aparecer. Nesta janela possvel escolher o tipo de arquivo que se deseja criar (Diagrama esquemtico, VHDL, etc). Selecione a opo VHDL file e clique em Ok. Ser aberto um arquivo texto onde o cdigo VHDL pode ser escrito. Depois de escrever este cdigo voc deve criar um smbolo baseado neste cdigo e em seguida, abrir um diagrama em bloco para inserir seu componente (criado com base no VHDL) para atribuio dos pinos e demais processos do projeto.
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Para salvar este arquivo clique em File -> Save as... e d um nome ao arquivo, salvando-o preferencialmente na pasta do projeto principal. OBS: Para arquivos de descrio de hardware, deve-se sempre lembrar que o nome da entidade principal do arquivo deve ser igual ao nome do arquivo. Dica, para escrever um cdigo VHDL voc pode utilizar os modelos disponveis no Quartus II. Basta clicar em Edit > Insert Template > VHDL e escolher o que deseja. Para compilar e simular o circuito em cdigo VHDL basta seguir o ltimo passo descrito no item 3 e depois os passos descritos no item 4 deste tutorial. Voc pode utilizar este arquivo de cdigo VHDL em outros projetos, bastando para isto fornecer o nome e endereo deste arquivo na tela descrita na figura 4 deste tutorial. Esta tela tambm pode ser acessada clicando em Project -> Add/Remove files in project.