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Puntos a tratar en nuestro trabajo: Aritmtica en punto flotante atendiendo a las operaciones o Suma y resta o Multiplicacin o Modos de precisin en punto flotante (segn IEEE-754) o Infinitos y NaN Aritmtica en punto flotante atendiendo al hardware que la realiza o Arquitectura de punto flotante en el Intel 8086 y PowerPC o Vision general de la FPU (Unidad de punto flotante)
BIBLIOGRAFIA
Estructura y diseo de computadores.- Patterson, Hennessy Arquitectura de computadores: Diseo desde un punto de vista cuantitativo Patterson, Hennessy Organizacin y arquitectura de computadores - Stallings
SUMA Y RESTA
Para sumar o restar con aritmtica utilizado en cuatro fases: Paso 1: Comprobacin de cero: en punto flotante, podemos dividir el algoritmo
Al ser la resta igual a la suma excepto por el cambio del signo, hemos de comenzar cambiando el signo del substraendo cuando nos encontremos con una resta, y adems de esto, si alguno de los operandos es cero daremos automticamente el otro como resultado. Paso 2: Alineacin de las mantisas:
Para realizar este paso, debemos alinear la coma decimal del nmero que tenga el exponente ms pequeo. Se necesita por tanto, una forma del nmero menor que encaje con el de mayor exponente. Paso 3: Suma de las mantisas:
Se suman las partes significativas, y adems, despus de la suma puede que tengamos que desplazar el resultado para normalizarlo. Cada vez que incrementemos o decrementemos el exponente debemos comprobar que dicho exponente cabe todava en su campo, es decir, que no hemos tenido desbordamiento. Paso 4: Normalizacin:
Consiste en desplazar a la izquierda los dgitos de la mantisa hasta que el ms significativo sea distinto de cero.
Imgenes: Diagrama de bloques de la suma y diagrama de una unidad aritmtica en coma flotante dedicada a la suma
MULTIPLICACION
Como comprobaremos a continuacin en este resumen, la multiplicacin es un proceso menos complicado que la suma o resta en coma flotante. Al igual que en la suma plantearemos el algoritmo de la multiplicacin en tres pasos diferenciados: Paso 1: Obtenemos el exponente de la multiplicacin sumando para ello los exponentes de ambos operandos. Debemos tener en cuenta que los exponentes pueden estar guardados en forma sesgada y que adems el resultado puede desbordar el campo del exponente. Paso 2: Multiplicamos las mantisas teniendo en cuenta el signo Paso 3: Si el producto no esta normalizado debemos corregirlo, pudiendo desplazar este producto a la derecha o a la izquierda y modificando el exponente, teniendo en cuenta que no haya desbordamiento. Paso 4: Redondeamos el resultado segn las reglas que hayamos establecido Paso 5: El signo del producto vendr dado por los signos de los operandos. Si son iguales el signo es positivo, si no, ser negativo.
PRECISION Y REDONDEO
Bits de guarda:
Antes de realizar una operacin en coma flotante se cargan en sendos registros tanto el exponente como la parte significativa. El registro que contiene la parte significativa posee tambin bits adicionales denominados bits de guarda, que se aaden a la derecha de la parte significativa en forma de ceros. Redondeo:
Un elemento muy a tener en cuenta en la precisin que obtenemos es la tcnica de redondeo que empleamos en la operacin. Segn el estndar IEEE-754 tenemos cuatro posibles alternativas a la hora de realizar este redondeo: o o o o Redondeo al ms prximo: El resultado se redondea al nmero representable ms prximo. Redondeo hacia infinito: el resultado se redondea por exceso hacia mas infinito Redondeo hacia menos infinito: el resultado se redondea por defecto hacia menos infinito Redondeo hacia cero: el resultado se redondea hacia cero.
Debemos tener en cuenta que el modo de redondeo que se asume por defecto es el redondeo al ms prximo en el cual deberemos tomar el valor representable ms prximo al resultado exacto. En el caso en el que el resultado se encuentre exactamente en la mitad de dos valores representables posibles, la aproximacin tomada en el estndar es forzar que el resultado sea par, de forma que el valor se redondea por exceso cuando el ultimo bit representable actual es 1 y se deja como esta si es 0.
INFINITO Y NaN
Aparte del redondeo (previamente comentado), el IEEE 754 detalla ms procedimientos para que la aritmtica en punto flotante produzca resultados uniformes y predecibles. Estos procedimientos son: el infinito y los NaN (Not a Number). Infinito: estas operaciones se tratan como casos lmite de la aritmtica real. Salvo en algn caso especial, en cualquier operacin en la que aparece el infinito el resultado es el que conocemos:
Cuando un ordenador moderno tiene que ejecutar una operacin de punto flotante, tiene 3 posibilidades para llevar a cabo dicha tarea: 1- Emulacin Las FPUs tienen un numero finito de operaciones implementadas. Mediante la emulacin por software se puede aumentar el numero de operaciones posibles pese a costa de un menor rendimiento. Dichas operaciones se implementan como operaciones simples de enteros que se llevan a cabo en la ALU (unidad aritmtico-lgica). 2- FPU integrada Las FPUs disponen de instrucciones que pueden dividirse en simples (suma, resta..) y complejas (divisin). En algunos casos las FPUs solo integran las operaciones simples mientras que las complejas son emuladas va software 3- FPUs aadidas (coporocesadores) Durante la dcada de los 80 era bastante comn encontrar FPUs como coprocesadores, entidades separadas de la CPU que generalmente eran adquiridas cuando se necesitaba hacer un uso intensivo de operaciones en punto flotante. Dichos coprocesadores se encontraban disponibles para la lnea Motorola 680x0, ordenadores gama alta Apple Macintosh y la serie comodore amiga. Tambin haba FPUs para microcontroladores. Los procesadores actuales llevan la FPU integrada